Контрольная работа: Устройство микропроцессорных систем

а) хранение восьмиразрядного двоичного числа; введённого параллельным или последовательным способом;

б) сдвиг хранимого в регистре восьмиразрядного двоичного числа на определённое количество разрядов влево и вправо.

Разрядность данного регистра определяется количеством информационных входов ( D0 – D7 ), в данном случае, К155ИР13 – восьмиразрядный регистр.

Режим параллельной записи двоичного числа обеспечивается возбуждением прямого статического входа S0 выбирающего параллельный режим ввода ( 1-й вывод микросхемы регистра ).

При подаче уровня логической единицы, стробирующего импульса, на прямой динамический вход синхронизации C микросхемы ( 11-й вывод ), триггеры установятся в состояние определённые действующим на входах D0 – D7 двоичным числом ( 1110101 ).

Строим диаграмму сдвига двоичного восьмиразрядного числа, вправо на четыре разряда.

Рис.3 Содержимое регистра в процессе выполнения последовательных сдвигов вправо на четыре разряда восьмиразрядного двоичного числа ( в скобках указаны номера выводов микросхемы ).

ЗАДАЧА 2

1. Приведите логическую схему суммирующего счётчика на асинхронных Т – триггерах с инверсными динамическими входами.

1.1 Постройте временную диаграмму работы данного счётчика.

2. Выберите из табл.2 микросхему счётчика для своего варианта.

2.1 Приведите условное графическое обозначение заданной микросхемы.

2.2 Укажите назначение всех выводов.

2.3 Объясните назначение данного счётчика.

3. Определите разрядность счётчика ( n ) и коэффициент пересчёта (N). Определите максимальное значение числа, которое может быть зафиксировано счётчиком в одном цикле, и запишите его двоичным кодом.

4. Укажите на рисунке п.2.1. сигналы, подаваемые на входы счетчика для предварительной записи двоичного кода, заданного в табл.2. Укажите номер входа, на который поступают импульсы, подлежащие счету в режиме сложения.

5. Выполните расчет и укажите на выходах (рис. П.2.1) двоичный код, зафиксированный в счетчике в режиме сложения после поступления заданного числа входных импульсов, если предварительно в нем был записан заданный двоичный код.

Данные приведены в табл.2.

Таблица 2

Тип микросхемы	Двоичный код	Число входных импульсов
К531ИЕ15	1000	75

Рис.4.Логическая схема четырехразрядного суммирующего счетчика на асинхронных Т-триггерах типа JK с инверсными динамическими входами

Рис.5.Временная диаграмма работы счетчика, представленного на рисунке 4.

Рис.6 Условное графическое обозначение микросхемы счётчика типа К531ИЕ15.