Курсовая работа: Вычислитель аналогового сигнала
0003FFH
000100H
0000FFH
000018H
000017H
000000H
2.1.3 Принципиальная схема
Аналоговые сигналы поступают через разъем XS1 и резисторы R1, R5 на выводы 2 операционных усилителей DA1…DA2. Операционные усилители усиливают сигналы приблизительно в 10 раз, после чего они поступают на входы D аналогового коммутатора DD2. В зависимости от того, какой адрес выставлен на адресном входе А0..А3, один из 2 сигналов поступает на его выход Q (в.32 DD4). Резисторы R1…R4, R5…R8 предназначены для установки коэффициента усиления операционных усилителей. Резисторы R1…R6 служат для балансировки операционных усилителей.
Сигнал, поступающий на вход IN АЦП (в.15 DA3) преобразовывается в цифровой код. Преобразование происходит при поступлении импульсов на вход CLC от процессора DD4. После окончания преобразования на выходе RAD (в.7 DA3) появляется логическая "1", поступающая на вход SCO процессора. С выходов D0…D11 АЦП цифровой код поступает на регистры "защелки" выполненных на микросхемах DD5, DD6. Регистры записывают и содержат достоверную информацию при наличии на входах CLK и EZ (в.11, 1 DD5, DD6) сигнала RDA. Сигнал RDA формируется логическим сложением микросхемой DD1.2 сигналов RD (чтение процессором из внешнего источника) и SELO (выбор порта). Все остальное время выходы регистров находятся в третьем состоянии для устранения искажений информации. С выходов регистров информация поступает на входы AD для обработки и хранения в ОЗУ. Номер канала устанавливается циклически по сигналу чтения АЦП путем подачи на вход счетчика DD3. Разрешение записи в регистр осуществляется сигналом SELO и происходит во время действия сигнала чтения АЦП.
Накапливаемая контроллером информация хранится в шестнадцатиразрядном ОЗУ, организованной в две "страницы" объемом по 128 Кбайт. Обмен с ОЗУ производится за два шинных цикла. Во время первого цикла на выводы AD0…АD15 процессора DD4 выставляется адрес, который фиксируется в регистрах адреса выполненных на микросхемах DD7, DD8. Фиксация адреса происходит при выставлении процессором сигнала на выходе ALE, который подается на входы CLK микросхемы регистров адреса (в.11 DD9, DD10). После снятия сигнала CLK на выходах Z регистров остается адрес в ОЗУ, который подается на адресные входы микросхем памяти DD10, DD11. Во время второго цикла процессор выставляет сигнал WR, поступающий на входы W/R микросхем ОЗУ (в.29 DD10, DD11), на выводы AD0…АD15 информацию, которая подается на выводы DIO и производит запись информации в ОЗУ. Если сигнал WR не выставляется процессором, ОЗУ находится в режиме "чтение" и процессор может считывать данные, поступающие на выводы AD0…AD15. Сигналы с выводов А17…А19 так же подаются на входы ОЗУ CS2 и CS1 (DD3, DD7) и CS1 (DD8, DD14) соответственно. При наличии логической "1" на линии А17 и логического "0" на линии А18 разрешается чтение или запись в первую "страницу" памяти (DD3, DD7). При наличии логической "1" на линии А17 и логического "0" на линии А19 разрешается запись или чтение во вторую "страницу" памяти (DD8, DD14). При наличии логического "0" на линии А17, ОЗУ блокируется и производится запись адреса в дешифратор адреса DD2.
Дешифратор адреса собран на микросхемах DD2, DD1.1 и DD1.2. Сигналы с выходов процессора А17…А19 поступают на выводы 1, 2 DD1.1 и вывод 5 DD1.2 соответственно. При наличии на этих выводах логического "0", на выводе 6 DD1.2 появляется строб импульс обращения к порту, подающий на вход CS микросхемы DD2. На линиях AD0…AD15 процессор выставляет адрес порта, который подается на адресные входы DD2. На выходах D0 микросхемы DD4 появляется управляющий сигнал SEL0…3, соответствующий выбранному порту.
Индикатор собран на семисегментных индикаторах 2х6. Процессор выставляет адрес на линиях АD0-4, записывает его в регистр адреса. При обращении процессора к порту индикатора DD2 выставляет на выводе 17 сигнал SEL1. Параллельно сигналы с линий AD0-15 записываются как отображаемая информация в регистры DD13 и DD14. Запись производится при наличии на входах CLK регистров сигнала SEL1. Одновременно по сигналу SEL1 адрес из регистра адреса поступает на дешифратор DD12, который, дешифруя поступившую на вход информацию, выбирает необходимый столбец для отображения информации. Информация из регистров DD13 и DD14 подается на индикаторы, включение которого происходит от дешифратора.
Цепь питания +5В содержит семь блокировочных конденсаторов C3-9, по одному на каждые три микросхемы, предназначенных для фильтрации помех, свойственных цифровым схемам.
3.2 Проверочные расчеты
3.2.1 Расчет потребляемой мощности
Расчет потребляемой мощности производится по формуле:
где: Pn – мощность, потребляемая микросхемой или иной радиодеталью, Вт; n – количество радиодеталей.
Таблица 2
| Тип микросхемы | Потребляемая мощность, мВт | Количество корпусов |
| AD1671 | 350 | 1 |
| 591КН3 | 30 | 1 |
| 140УД6 | 75 | 2 |
| 8XC196NT | 1000 | 1 |
| 61256 | 300 | 2 |
| 1533ИЕ5 | 75 | 2 |
| 1533АП6 | 120 | 1 |
| 1533ЛН1 | 270 | 1 |
| 155ЛЛ2 | 300 | 1 |
| 1533ИР22 | 275 | 7 |
| 1533ИД3 | 75 | 2 |
| PPI | 200 | 1 |
| PLM | 130 | 1 |
Рmax =0,35*1+0,030*1+0,075*2+1*1+0,3*2+0,075*2+0,12*1+0,27*1+
0,3*1+0,275*7+0,075*2+0,2*1+0,13*1=5,375 Вт
Полученное значение потребляемой мощности является приемлемым.
3.2.2 Расчет на нагрузочную способность
Наиболее нагруженным элементом является процессор. Основное число потребителей его сигнала подключено к линиям AD. Максимальное число входов, подключаемых к одному выходу достигает 2 в двух режимах: отображение информации на индикаторе и обмен с ОЗУ. Максимальный ток, который может отдавать один выход процессора – 25 мА. Ток потребляемый входами микросхем: 1533ИД3 – 1,7 мА; 1533ИР22 – 1,5 мА; 61256 – 2 мА;
При отображении на индикаторе потребление от одного входа составляет: 1,5+1,7=3,2 мА что является удовлетворительным, так как значительно меньше максимально допустимого. При обмене с ОЗУ ток потребления составляет: 1,5+2=3,5 что также является удовлетворительным.
3.2.3 Расчет на время распространения сигнала
Важным и наиболее затратным по времени является обмен с портами. Сигналы распространяются по нескольким путям, при этом может возникнуть ситуация "гонки по тракту". Наиболее критичным выберем чтение информации из АЦП процессором, так как при несоблюдении ограничений, накладываемых используемой элементной базой возможны серьезные искажения информации. Тактовая частота процессора составляет 20МГц. Тогда период обмена по шине составляет 0.05 мкс. Расчет времени распространения сигнала по цепи производится по формуле:
;
где: tЗ n – время задержки прохождения сигнала через микросхему, нс.