Реферат: Шина INTEL ISA

линии адреса А<07...00> с одним из 256 адресов регенерации. Другие линии адреса

неопределены и должны устанавливаться в третье состояние источниками, которые

могут возбуждать их. Цикл представляет собой цикл доступа нормального типа или

типа готовности при разрешенных MEMR* и MRDC*.

ВНИМАНИЕ!

Цикл регенерации должен выполняться каждые 15 мксек для доступа ко всем адресам

динамического ОЗУ каждые 4 мсек. Если это не происходит, данные в ОЗУ могут быть

потеряны.

В табл. 5.4.1 и 5.4.2 показаны источники сигналов линий, которые являются

запускающими или принимающими для цикла регенерации, когда контроллер

регенерации или плата расширения является владельцем шины соответственно. Они

определяют также тип драйвера.

Примечание к табл. 5.4.1.: основной ЦП = PRI, плата расширения = ADD, контроллер

ПДП = DMA, контроллер регенерации = REF, память основной платы = MEM, ввод/вывод

основной платы =IO, TTL = = К1533 или К555, OC - открытый коллектор и TRI -

приемники/передатчики с тремя состояниями.

"-" указывает на то, что соответствующая линия не разрешена или не

контроллируется источником.

"x"-игнорируется. Источник может разрешить сигнал, но он будет игнорироваться

другими источниками. _

(1) DRQ# может быть запущен, но не воспримется, пока контроллер ПДП является

задатчиком шины.

(2) Принят основным ЦП через контроллер прерываний и задействуется по усмотрению

основного процессора, когда он является задатчиком шины.

(3) Этот сигнал должен контроллироваться постоянно и при разрешении немедленно

восприниматься.

(4) Всегда принимается устройством обмена байтами данных.

(5) Приводится в действие источниками основной платы, если адрес находится в

первом Mбайте адресного пространства и есть сигнал или MRDC* или MWTC*.