Курсовая работа: Цифро-аналогові перетворювачі
При керуванні ЦАП від цифрових пристроїв з жорсткою логікою керуючі коди ключів ЦАП можуть бути безпосередньо підключені до вихідних виводів цифрових пристроїв, тому у багатьох моделях ЦАП, особливо більш радніших (572ПА1 та ін.) суттєва цифрова частина відсутня. Якщо ЦАП входить у склад мікропроцесорної системи та одержує вхідний код від шини даних, то його потрібно оснастити пристроями, що приймають вхідне слово від шини даних, та керувати ключами ЦАП і зберігати слово до надходження нових даних. В залежності від способу завантаження вхідного слова в ЦАП розділяють перетворювачі з паралельним та послідовним інтерфейсами вхідних даних.
ЦАП з послідовним інтерфейсом вхідних даних
Такий ЦАП має на кристалі окрім власне ЦАП додатково також послідовний регістр завантаження, паралельний регістр збереження та керуючу логіку (рис.12,а).
Рис.12. а) ЦАП з послідовним інтерфейсом; б) діаграми напруг.
При активному рівні сигналу CS (лог.”0”) вхідне слово довжини N (що дорівнює розрядності ЦАП) завантажується по лінії DI в регістр зсуву під керуванням тактової послідовності CLK/ Після закінчення завантаження, виставивши на лінію LD активний рівень, вхідне слово записують у регістр збереження, виходи якого безпосередньо керують ключами ЦАП. Для того, щоб мати можливість передавати по одній лінії даних вхідні коди у декілька ЦАП, останній розряд регістру зсуву у багатьох моделей ЦАП з послідовним інтерфейсом з’єднується з виводом D0. Цей вивід з’єднується зі входом DI наступного ЦАП і т.і.
Як приклад на рис.12,б розглянута часова діаграма, що відтворює процес завантаження вхідного слова у ЦАП AD7233. Мінімально досяжні інтервали часу (порядку 50 нс), що позначені на часових діаграмах, вказуються в технічній документації на мікросхему.
На рис.13 наведений варіант схеми підключення перетворювача з послідовним інтерфейсом до мікроконтролера (МК). На час завантаження вхідного слова в ЦАП через послідовний порт мікро контролера, до котрого можуть бути також підключені інші приймачі, на вхід CS (вибір кристалу) подається активний рівень з однієї з ліній введення-виводу МК. після закінчення завантаження МК міняє рівень на вході CS, як це показане на рис.12,б, та виставивши активний рівень на вході LD ЦАП, забезпечує пересилку вхідного коду з регістра зсуву ЦАП в регістр збереження. Час завантаження залежить від тактової частоти МК і звичайно близько 1 мкс. Мінімальна кількість ліній зв’язку з ЦАП забезпечується двох провідним інтерфейсом I2C.
Рис.13. Підключення схеми перетворювача до мікроконтролера
ЦАП з паралельним інтерфейсом вхідних даних
На N входів даних N-розрядного ЦАП подається все вхідне слово. Інтерфейс такого ЦАП має два регістри збереження та схему керування (рис.14,а).
Рис.1 а) ЦАП з паралельним інтерфейсом; б) діаграма напруг
Два регістри збереження потрібні, якщо пересилання вхідного коду в ЦАП та установка вихідного аналогового сигналу, що відповідає цьому слову, повинні бути розділені в часі. Подача на вхід асинхронного скиду CLR сигналу низького рівня призводить до занулення першого регістру, і відповідно вихідної напруги ЦАП.
Приклад блок-схеми підключення 12-розрядного ЦАП МАХ507 до 16-розрядного мікропроцесора наведений на рис.15. Процесор надсилає вхідний код в ЦАП як у комірку пам’яті даних. Спочатку з шини адреса-дані поступає адреса ЦАП, яка фіксується регістром по команді з виходу ALE мікропроцесора і, пізніше, після дешифрації активізує активізує вхід CS ЦАПю Услід за цим МП подає на шину адреса-дані вхідний код ЦАП, а потім сигнал запису на вхід WR (див. рис.14,б).
Рис.15. Підключення ЦАП до мікропроцесору.
5. Параметри ЦАП
При послідовному наростанні значень вхідного цифрового сигналу D(t) від 0 до 2N-1 через одиницю молодшого розряду (ОМР) вихідний сигнал Uвих(t) утворює східчасту криву. Таку залежність звичайно називають характеристикою перетворення ЦАП. У відсутності апаратних похибок середні точки розміщені на ідеальній прямій 1 рис.16, якій відповідає ідеальна характеристика перетворення.
Рис.16. Ідеальна характеристика перетворення
Реальна характеристика перетворення може суттєво відрізнятись від ідеальної розмірами та формою ступенів а також розміщенням на площині координат. Для кількісного опису цих розходжень існує цілий ряд параметрів.
Статичні параметри
Роздільна здатність – прирощення Uвих при перетворенні суміжних значень Dj, що відрізняються на ОМР. Це прирощення є шагом квантування. Для війкових кодів перетворення номінальне значення шагу квантування h = Uпш/(2N-1), де Uпш – номінальна максимальна вихідна напруга ЦАП (напруга повної шкали), N – розрядність ЦАП. Чим більша розрядність перетворювача, тим вища його роздільна здатність.
Похибка повної шкали – відносна різниця між реальним та ідеальним значеннями границі шкали перетворення при відсутності зміщення нуля:
dпш = eпш 100%/Uпш.
Є мультиплікативною складовою повної похибки. Інколи її указують відповідним числом ОМР.
Похибка зміщення нуля – значення Uвих, коли вхідний код ЦАП дорівнює нулю. Є адитивною складовою повної похибки. Звичайно указується в мілівольтах або в процентах від повної шкали: