Реферат: Разработка одноплатного микроконтроллера

Адаптер параллельного интерфейса построен на ИМС КР580ВВ55А, который обеспечивает стробированный и нестробированный ввод/вывод информации по параллельным каналам связи, сбор данных с внешних измерительных устройств и (или) управление исполнительными устройствами.

Микросхема КР580ВВ55А — программиру­емое устройство ввода/вывода параллельной информации, применяется в качестве элемен­та ввода/вывода общего назначения, сопря­гающего различные типы периферийных уст­ройств с магистралью данных систем обра­ботки информации. Условное графическое обозначение микро­схемы приведено на рис. 12. Назначение выводов приведено в таблице 2.

О

Характеристики ИМС:

Р_потр= 680 мВт:

t_выбор= 110 нс.

???? ??????????? ????? ??????????? ?????? ?????? ? ??????????? ??560??55? ?????????????? ????? 8-????????? ???????????????? ?????????????? ????? ?????? (D). ??? ????? ? ????????????? ???????????? ????????????? 24 ????? ??????/??????, ???????????????? ? ??? 8-???????? ?????? ВА, ВВ, ВС, ??????????? ???????? ??????????, ? ??????? ?????? ??????? ???????????? ???????????? ????????.

Память программ хранится в постоянном запоминающем устройстве ПЗУ выполненом на ИМС К573РФ8 представляет собой многократное программируемое ПЗУ, выполненное по ЛИЗМОП технологии. Стирание записанной информации производится с помощью ультрафиолетового облучения. Емкость ИМС 573РФ8 составляет 32К*8 бит. Условное графическое обозначение микро­схемы приведено на рис. 13.

Промежуточные значения вычислений хранятся в оперативном запоминающем устройстве (ОЗУ) построенном на микросхеме К537РУ17 8К*8 бит. Обозначение микро­схемы приведено на рис. 14.

Микросхемы этой серии представляют из себя ОЗУ статического типа т.е. каждый элемент памяти выполнен на тригерах. Микросхема выполнена на МОП транзисторах.

В устройствах памяти на этих микросхемах для снижения потребляемой мощьности следует предусматреть возможнось автоматического переключения на источник с меньшим напряжением для хранения информации достаточно 2,2 вольта. Также может быть предусмотрен дополнительный источник питания для обеспечения автономной работы блока памяти при случайном отключении питания.

2.Разработка принципиальной схемы микроконтроллера

2.1 Разработка процессорного модуля

Микропроцессорное ядро (процессорный модуль, ПМ) самая важная часть микроконтроллера. Для построения процессорного ядра прежде всего решают задачу тактирования МП в 8088 это делают с помощью тактового генератора к1810ГФ4. Кроме этого необходимо произвести демультиплексирование магистрали адрес-данные и формирование шины управления в максимальном режиме с помощью контроллера системной шины.

На рисунке 15 показана схема синхронизации работы процессора и сброса. Сигналы синхронизации формируются из колебаний оснавной частоты кварцевого резонатора ZQ1, подключенного ко входам Х1,Х2, микросхемы, через конденсатор C1 емкостью 3…10 пф. Частота работы процессора 5мгц

частота кварцевого резонатора = 3F*fраб МП (при использовании к1810ГФ4). Сигнал готовности формируется при наличии на входе хотябы одного из REY1 или 2. Ко входу RES подключена время задающая RC цепочка которая формирует длительность сигнала сброса R=510 кОм,C=1 мКф (минимальная продолжительность сигнала сброс 50мкс).

Максимальный режим работы предназначен для работы ЦП с несколькими МП или сопроцессором для этого на вход микропроцессора MN\MX подается значение логической (1). Организация буферизации шины показана на рисунке 16. Регистры DD 4, DD 5, DD 6, запоминают адрес установленный микропроцессором по приходу сигнала ALE (строб адреса), на вход «строб(STB)» каждого из регистров смотри рисунок 17 “Временные диаграммы работы процессора”. Адрес устанавливается в первом цикле Т1 (выделено см. рис) и сохраняется до канца цикла.

.

Буферный усилитель DD7 усиливает сигналы шины данных в двух направлениях это нужно для обеспечения нормальной работы процессора (из за нагрузочной способности входов МП). Буферный усилитель управляется стробом данных (DEN) МП (контроллер системной шины DD12 в максимальном режиме работы МП), который подается на вход OE микросхемы DD7 в каждом машинном цикле см.(рис 18) и сигналом определяющим направление передачи данных (DT\R) он подается на вход T.

Шина управления формируется с помощью микросхемы DD12. Блок управления работает по таблице истиности (минимальный режим таблица 3). И по таблице в максимальном с помошью контроллера системной шины

Таблица 3. Алгоритм работа схемы управления

RD	WR	M\IO	MEMR	MEMWR	IO\R	IO\WR
1	1	1	1	1	1	1
0	1	1	0	1	1	1
1	0	1	1	0	1	1
0	1	0	1	1	0	1
1	0	0	1	1	1	0

Таблица декодирования сигналов управления системного контроллера.

S1	S2	S3	Сигнал управления	Тип цикла шины
0	0	0	INTA	Подтверждение прерывания
0	0	1	IORC	Чтение ВУ
0	1	0	IOWC,AIOWC	Запись ВУ
0	1	1	-------	Останов
1	0	0	MRDC	Выборка команды
1	0	1	MRDC	Чтение ЗУ
1	1	0	MWTC,AMWC	Запись ЗУ
1	1	1	-------	Цикла шины нет

CLK

t

t

ALE