Реферат: Шина INTEL ISA

относительно задатчика шины.

7.1.1 ГРУППА СИГНАЛОВ АДРЕСА

Группа сигналов адреса состоит из сигналов, управляемых задатчиком шины, для

определения адреса данных.

А <19...0> [8] [8/16]

Сигналы адреса защелкиваются выходами, управляемыми задатчиком шины. При доступе

к адресному пространству памяти они представляют самые младшие 20 адресных бита

и определяют адресное пространство 1 Мбайт. Когда выбирается адресное

пространство внешнего устройства, А <15...0> содержит достоверный адрес и A

<19...16> не определяются.

Во время циклов регенерации A <07...00> содержит достоверный адрес, A <19...08>

не определяются и должны устанавливаться в третье состояние всеми ресурсами,

которые могут ими управлять.

ОСНОВЫ ПРОЕКТИРОВАНИЯ ПЛАТЫ РАСШИРЕНИЯ

Плата расширения должна быть задатчиком шины для разрешения линии MEMREF*. Когда

она разрешена, линии адресов управляются от контроллера регенерации; они должны

быть на плате расширения в третьем состоянии.

LA <23...17> [8/16]

Незащелкнутые адресные сигналы возбуждаются задатчиком шины. Когда главный

центральный процессор становится задатчиком шины, линии LA - достоверные при

наличии BUSALE, но недостоверные для всего цикла. Когда контроллер прямого

доступа к памяти (DMA) является задатчиком шины, линии LA должны быть

достоверными до MRDC* или MWTC* и остаются достоверными весь цикл. При доступе к

адресному пространству памяти они представляют семь самых старших адресных

битов. При доступе к адресному пространству внешних устройств (IO) или во время

циклов регенерации эти линии переходят в логический 0.

Во время циклов регенерации линии незащелкнутых адресов не определяются и должны

устанавливаться в третье состояние всеми ресурсами, которые могут ими управлять.

ОСНОВЫ ПРОЕКТИРОВАНИЯ ПЛАТЫ РАСШИРЕНИЯ