Дипломная работа: Выбор и обоснование структурной и принципиальной электрических схем
Принципиальная схема полосового фильтра приведена в приложении 2.
Полосовой фильтр состоит из двух цифровых компараторов, каждый из которых производит сравнение кода частоты биений с опорным кодом верхней и нижней границы полосы соответственно. Сигналы с цифровых компараторов поступают на схему суммирования по модулю 2, сигнал с выхода которой несет информацию о нахождении сигнала относительно полосы пропускания фильтра.
1.2.6 Обнаружитель
Принципиальная схема обнаружителя приведена в приложении 3 на рисунке П3.1 .
Обнаружитель построен на базе реверсивного счетчика, направление счета которого регулируется в зависимости от попадания принятого сигнала в допустимую полосу. После накопления восьми импульсов на выходе появляется сигнал «Захват», а при накоплении импульсов до пятнадцати появляется сигнал переполнения, который, поступая на сумматор по модулю 2, запрещает дальнейшее прохождение тактирующих импульсов на вход обнаружителя.
1.2.7 Схема выдачи сигнала «Разрешение»
Принципиальная схема устройства выдачи сигнала «Разрешение» приведена в приложении 3 на рисунке П3.1 .
Схема выдачи сигнала «Разрешение» представляет собой 8-ми разрядный двоичный счетчик, производящий подсчет импульсов, поступающих с тактового генератора со знаком в зависимости от выходного сигнала обнаружителя. По достижении 128 импульсов на выходе 8-го разряда счетчика появляется сигнал «Разрешение», а по достижении 256 импульсов, сигнал с выхода перегрузки запрещает дальнейшее прохождение тактов на вход счетчика, с помощью сумматора по модулю 2.
1.2.8 Схема формирования сигнала «Исправность»
Принципиальная схема устройства формирования сигнала исправность приведена в приложении 4 на рисунке П4.1 .
Схема формирования сигнала «Исправность» представляет собой восьми разрядный двоичный счетчик, производящий подсчет импульсов Тизм. Триггер обеспечивает корректную работу схемы при установлении и снятии сигнала «Исправность». Сумматор по модулю 2 обеспечивает сброс счетчика при исчезновении сигнала «Разрешение».
1.2.9 Коммутаторы
Для обеспечения управления режимами работы в блоке предусмотрены коммутаторы. Коммутатор управления режимом выполнен на микросхеме 564КП1, а коммутатор выдачи сигналов на интегратор ошибки и выход блока на микросхеме 564ЛС2.
1.2.10 Интегратор ошибки
Принципиальная схема интегратора ошибки приведена в приложении 4 на рисунке П4.2 .
Интегратор ошибки состоит из счетчиков и ЦАП. Счетчики формируют цифровой код, который ЦАП преобразует в соответствующее управляющее напряжение. Цифровой код на выходе счетчиков зависит от подаваемой на них частоты Fт и значения сигнала крутизны ± S.
2 Описание и работа устройства
2.1 Описание блока ПЗК
Сигнал биений Fб поступает через ограничитель на первый вход триггера, на второй вход которого поступает измерительный интервал («Тизм»). Временная диаграмма сигналов приведена на рисунке 2.1.1 а,б.
При наличии импульса измерительного интервала в виде уровня «Лог 1» положительный перепад сигнала биений с выхода ограничителя устанавливает уровень «Лог 0» на втором (инверсном) выходе триггера и уровень «Лог 1» на первом выходе триггера.
Со второго выхода триггера сигнал с частотой биений поступает на первый вход счетчика 1, на второй вход которого с разъема приходит сигнал с частотой 1600 кГц .
С приходом отрицательного перепада второго импульса частоты с выхода кварцевого генератора на первом выходе счетчика 1 появляется уровень «Лог 1» , а с приходом четвертого – на втором выходе.
Уровень «Лог 1» со второго выхода счетчика 1, поступая на третий вход триггера и первый вход счетчика 2, приводит к обнулению триггера и счетчика 2. Уровень «Лог 1» со второго выхода триггера поступает на первый вход счетчика 1 и производит установку в нуль выходов счетчика 1. Таким образом на первом выходе счетчика 1 формируются импульсы длительностью, равной удвоенному периоду кварцевой частоты (рисунок 2.1.1 е) в начале каждого периода частоты биений.
С выхода 1 триггера, после его обнуления и обнуления счетчика 2 , сигнал в виде «Лог 0» поступает на третий вход счетчика 2, на второй вход которого через схему 2И-НЕ поступает частота с выхода кварцевого генератора. Счетчик 2 считает количество импульсов частоты кварцевого генератора (1600 кГц) на временном интервале (t2 – t3 ) (рис.2.1.1 д), т.е. производит дискретную оценку интервала по формуле (2.1.1):
Тб – (3,5 ± 0,5)Ткв (2.1)
где Тб - период частоты биений;
Ткв - период частоты кварцевого генератора.
Импульсы кварцевого генератора проходят на вход схемы 2И-НЕ до тех пор, пока не появится уровень «Лог 1» на выходе схемы сравнения кодов 3 и, следовательно, уровень «Лог 0» на выходе инвертора 2.
Таким образом, при длительности периода больше Тбmax прекращается дальнейшее заполнение счетчика 2. С выходов счетчика 2 (разряды 3…6) параллельный код, соответствующий длительности интервала (t2 – t3 ) поступает на входы А схем сравнения кодов 1, 2, 3.
Схема сравнения кодов 1 (ССК 1) сравнивает опорный код 1, заданный на выводы В, с кодом периода частоты биений, поступающим на выводы А .
Если период сигнала биений превышает период соответствующий переходной частоте дискриминатора Тб0 , то на выходе ССК 1 появляется уровень «Лог 1» . Этот уровень «Лог 1», при наличии уровня «Лог 1» на выходе реверсивного счетчика, инвертируется инвертором 1 (2И-НЕ).
С выхода инвертора 1 через коммутатор 2 сигнал в виде уровня «Лог 0» выдается на выход «± S» блока. Этот сигнал определяет знак изменения крутизны модулирующего напряжения. Уровень «Лог 1» на выходе «± S» соответствует управлению в направлении уменьшения крутизны модулирующего напряжения, а уровень «Лог 0» - увеличения.
Схемы сравнения кодов 2 и 3 (ССК 2 и ССК 3) работают аналогично. На входе В ССК 2 задан опорный код 2, а на входе В ССК 3 – опорный код 3. На выходе ССК 2 появляется уровень «Лог 1», когда период сигнала биений превышает Тбmin , а на выходе ССК 3 появляется уровень «Лог 1», когда период сигнала биений превышает Тбmax . ССК 2, ССК 3, инвертор 2 и мажоритарный элемент 1 обеспечивают селекцию импульсов по длительности и формируют полосу пропускания сигнала биений. В режиме измерения высоты на входе 2 мажоритарного элемента 1 присутствует уровень «Лог 0». При этом на выходе мажоритарного элемента 1 формируется уровень «Лог 1», если частота сигнала биений находится в полосе Fбmin < Fб < Fбmax , и уровень «Лог 0», если частота сигнала биений находится за указанной полосой.
Сигнал с выхода мажоритарного элемента 1 поступает на вход «± 1» реверсивного счетчика. На вход С реверсивного счетчика через мажоритарный элемент 2 поступает последовательность импульсов Fт с выхода 1 счетчика 1. Когда на вход «± 1» реверсивного счетчика поступает уровень «Лог 1», реверсивный счетчик производит сложение («Лог 0» – вычитание) последовательности импульсов с выхода 1 счетчика 1.
Когда реверсивный счетчик накопит восемь импульсов, на его выходе 1 (выход четвертого разряда) формируется сигнал в виде уровня «Лог 1» («Быстрый захват») рисунок 2.1.2 б.
Последующее накопление импульсов до 15 приводит к появлению на выходе CR реверсивного счетчика сигнала переполнения в виде уровня «Лог 0», который поступая на второй вход мажоритарного элемента 2, запрещает прохождение импульсов Fт с выхода счетчика 1 через мажоритарный элемент 2 на вход С реверсивного счетчика. Если частота сигнала биений находится за пределами полосы Fбmin < Fб < Fбmax с выхода мажоритарного элемента 1 на вход «± 1» реверсивного счетчика поступает уровень «Лог 0», и счетчик производит вычитание последовательности импульсов Fт , подаваемой на вход С реверсивного счетчика. После того, как содержимое счетчика станет меньше семи, на выходе 1 реверсивного счетчика появляется уровень «Лог 0» (снимается сигнал «Быстрый захват»).
Сигнал «Быстрый захват» с выхода 1 реверсивного счетчика поступает на вход «± 1» схемы выдачи сигнала «Разрешение», которая представляет собой 8-разрядный реверсивный счетчик.