Курсовая работа: Реализация устройства обработки информации

I_DH = m_c * I_IDH = 2 * 2 = 4 мА

C_D = m_c * C_ID + C_m = 2 * 5 + 20 = 30 пФ

где I_IDL , I_IDH - входные токи логического 0 и логической 1 по информационным цепям выбранной БИС ОЗУ. C_ID - входная емкость по информационному входу БИС ОЗУ.

Определяем токи нагрузки и емкостную нагрузку для схем ввода адреса по адресным цепям БИС ОЗУ по формулам:

I_AL = m * I_IAL = 2 * 3,2 = 6,4 мА

I_AH = m * I_IAH = 2 * 2 = 4 мА

C_A = m * C_IA + C_m = 2 * 5 + 20 = 30 пФ

где I_IАL , I_IAH - входные токи логического 0 и логической 1 по адресным цепям выбранной БИС ОЗУ. C_IА - входная емкость по адресному входу БИС ОЗУ.

Определяем токи нагрузки I_CSL и I_CSH и величину емкостной нагрузки С_CS по цепям выбора микросхем (CS) по формулам:

I_CSL = m_p * I_ICSL = 1 * 3,2 = 3,2 мА

I_CSH = m_p * I_ICSH = 1 * 2 = 2 мА

C_CS = m_p * C_ICS + C_m = 1 * 5 + 20 = 25 пФ

где I_ICSL , I_ICSH - входные токи логического 0 и логической 1 по цепям выбора (CS) БИС ОЗУ. C_СS - входная емкость по цепям выбора (CS) БИС ОЗУ.

Рис. 3 Условное графическое обозначение ОЗУ К537РУ17

Наименование выводов:

A0 ÷ A12 – адресные входы.

W/R – запись/чтение.

CS1, CS2 – chip select, чип выбора.

CEO – разрешающий выход.

D0 ÷ D7 – шина данных ввода/вывода.

ОЗУ представляет собой статическое асинхронное оперативное запоминающее устройство.

Режимы работы:

W/R	CS1	CS2	OE	A0..12	D0..7	Режим
Х	Н	X	X	Адрес	Данные	Хранение
Х	Х	L	Х			Хранение
Н	L	Н	H			Запрет выхода
Н	L	H	L			Чтение
L	L	Н	Н			Запись
L	L	Н	L			Запись

2.3 Описание адаптера параллельного интерфейса

Адаптер параллельного интерфейса служит для расширения разрядности шины данных, а также приводит к повышению нагрузочной способности.

Адаптер параллельного интерфейса i8255 имеет три восьмиразрядных порта А, В и С с 3-м состоянием. Причем порт С разделен на две тетрады. Все три порта могут быть запрограммированы на ввод или вывод, причем каждая тетрада порта С может быть запрограммирована раздельно. Данные поступают в АПИ через шину данных D0…D7. С помощью сигнала CS осуществляется выбор кристалла, если сюда поступает низкий уровень сигнала, то порты будут установлены в 3-е состояние. А1, А0 – младшие разряды адреса, они служат для адресации внутренних регистров адаптера. Если количество линий ввода и вывода превышает возможности адаптера, то следует применить несколько адаптеров.

Рис. 4 Условное графическое обозначение АПИ i8255

Наименование выводов: