Реферат: Выбор логической структуры процессора

N+4 │ │ │ │ │----├────┼────┤----│════│----│

│ │ │ │ │ │ ВК │ РК │ АО │ ВО │ ОП │ ЗР

N+5 │ │ │ │ │ │----├────┼────┤----│════│----│

│ │ │ │ │ │ │ │ │ │

N такта: 1 2 3 4 5 6 7 8 9 10 11

Рис.2. Принципы совмещения выполнения команд.

Команды от ОП

Буферы ┌───────────┬──────────────┐ ┌────────────

команд ┌──┴──┐ ┌──┴──┐ ┌───┴───────┴────┐

├─────┤ ├─────┤ │Сверхоперативная├───────

├─────┤ ├─────┤ │буферная память │ к ОП

├─────┤ ├─────┤ │ (кэш-память) ├──┬────

└──┬──┘ └──┬──┘ └───┬────────────┘ │

┌ ─ ─ ─ ─ ─│─ ─ ─ ─ ─ ─│─ ─ ─ ─ ─ ┐ │ Операнды │

┌───────┴───────────┴───────┐ │ ┌─────────┐ │

┌──┼──┤ Регистр команд ├──┼───┼──┤Локальная│ │

│ └───────┬───────────────────┘ │ │ память │ │

│ │ │ │ │ └──┬────┬─┘ │

│ БВК │ ┌──────────────┼─────┤ │ │

│ │ ──────┴──── ────┴────── │ │ │ │ │

│ Адресный сумматор │ │ │ │

│ │ ──────────┬────────── │ │ │ │ │

│ └ ─ ─ ─ ─ ─ ─ ─ ─│─ ─ ─ ─ ─ ─ ─ ─ ┘ │ │ │ │

│ ├────────────────────┼─────┘ │ │

│ ┌ ─ ─ ─ ─ ─ ─ ─ ─│─ ─ ─ ─ ─ ─ ─ ─ ┐ │ │ │

│ ┌─────────────┴─────────────┐ │ │ │

│ │ │ Регистр адреса │ │ │ │ │

│ └─────────────┬─────────────┘ │ │ │

│ │ └────────────────┼───┼──────────┼────┘