- триггер "Готовность" (Тг ГОТ);

- буфер-формирователь (BF);

- блоки оптронной развязки (БОР).

Адресный дешифратор производит выбор порта (регистра или триггера) с которым производится обмен информацией путем дешифрации его адреса, поступившего с ША. По сигналу, поступающему с ДШ, производится либо синхронизация вводимой информации в порт , либо вывод выходов порта из высокоимпедасного состояния при чтении содержимого портов.

Регистр ЦАП служит для хранения цифрового эквивалента управляющего напряжения для его последующего преобразования в аналоговую вели чину в цифро-аналоговом преобразователе.

Регистр АЦП служит для приема и хранения цифрового эквивалента напряжения тахогенератора U_ТГ , после его преобразования в АЦП.

Регистр вектора прерывания хранит код команды RST. По сигналу "Чтение контроллера прерываний" выходы регистра выводятся из высокоимпедансного состояния, что обеспечивает выдачу хранимого кода на ШД.

Информационный вход триггера СБ подключается к одному из разрядов ШД. Синхронизация записи в триггер осуществляется сигналом с ДШ.

Запись информации в триггер ГОТ осуществляется внешними сигналами (информационным и синхронизирующим), поступающими с электропривода. Для того, чтобы не блокировать один из разрядов ШД состоянием триггера (0 или 1) выход триггера подключается к одному из разрядов ШД через буфер-формирователь (ВF), имеющий третье состояние. Вывод буфера из этого со стояния (подключение триггера к ШД) осуществляется сигналом с ДШ.

5.1 Разработка адресного дешифратора

Начальный адрес портов интерфейсного модуля – Е3 .

Тогда адреса остальных портов определяются соответственно – Е4, Е5 и Е6.

Представим адреса портов в двоичном коде:

А7…... A0 - разряды ША ;

1110 0011 - адрес RG ЦАП ( порт 1 ) ;

1110 0100 - адрес RG АЦП ( порт 2 ) ;

1110 0101 - адрес Тг СБ ( порт 3 ) ;

1110 0110 - адрес Тг ГОТ ( порт 4 ) .

Дешифрация, т.е. обращение к портам, будет иметь место только в том случае, если хотя бы один из сигналов ЧтВВ или ЗпВВ примет нулевой уровень (обращение к портам ввода/вывода).

5.2 Разработка регистра вектора прерывания

Структура команды RST , код которой хранит RG ВП, имеет следующий вид:

Д7............... Д0 - разряды ШД ;

1 1 x x x 1 1 1 - код команды .

где xxx - двоичный код вектора прерывания.

При четвертом векторе - 11101111. Учитывая, что логической 1 соответствует уровень напряжения > 2,4 В, а логическому 0 - уровень < 0.4 В входы регистра ( в соответствии с полученным кодом RST) подключают к питанию +5В или к нулевому проводу (Рис.4).

Рис.4

6. Разработка программного обеспечения

Разработка программного обеспечения включает в себя разработку подпрограммы пуска ЭД, подпрограммы обслуживания прерывания и распределение памяти.

6.1 Разработка подпрограммы пуска ЭД

Блок-схема подпрограммы пуска ЭД, реализующая алгоритм, представлен на рис. 5.

В начале подпрограммы необходимо разрешить микропроцессору обслуживание прерывания и установить указатель стека на выбранный адрес ОЗУ.