Курсовая работа: Разработка схемы блока арифметико-логического устройства для умножения двух двоичных чисел

где – максимальное количество тактов.

При умножении целых чисел методом последовательного суммирования максимальное количество тактов будет определяться величиной множителя Y. Для восьмиразрядного множителя при совмещении операций сложения и сдвига в один такт максимальным значением является восемь. Помимо этих 8 тактов понадобится один такт для начальной установки регистров и счетчика (состояние ) и еще один такт для установки сигнала READY по окончании счета. Следовательно, общее число тактов, а максимальное время вычисления

или .

Полученное значение меньше заданного ограничения 2 мкс.

4.3 ОПРЕДЕЛЕНИЕ ПОТРЕБЛЯЕМОЙ МОЩНОСТИ

Потребляемая устройством мощность будет равна сумме мощностей, потребляемых всеми ее составными частями (регистры X и Z, счетчик, сумматор, схема сравнения, три логических элемента 2И-НЕ и устройство управления):

. (4.4)

Подставляя численные значения, получим потребляемую устройством мощность:

.

Реальная потребляемая мощность оказалась меньше заданного ограничения 1000 мВт.


ЗАКЛЮЧЕНИЕ

В результате выполнения данного курсового проекта был разработан блок АЛУ для умножения двух положительных двоичных чисел. Все требования, оговоренные в техническом задании, были выполнены.

Разработанное устройство имеет по 8 входов для множителя Y0 – Y7 и множителя X0 – X7, вход разрешения начала счета START с активным уровнем "1", вход принудительного сброса с активным уровнем "1" и вход синхронизации с тактированием по фронту импульса; 16 выходов результата Z0 – Z15 и выход готовности результата READY с активным уровнем "1".

Максимальное время счета .

Потребляемая мощность .


СПИСОК ИСПОЛЬЗОВАННОЙ ЛИТЕРАТУРЫ

1. Курс лекций по дисциплине "Техническое обеспечение и внешние устройства ЭВС". / Под ред. А.В. Тютякина – ОрелГТУ, 2000.

2. Курс лекций по дисциплине "Расчет и конструирование элементов ЭВС". / Под ред. И.И. Неврова – ОрелГТУ, 2000.

3. Курс лекций по дисциплине "Аналоговая и цифровая электроника". / Под ред. А.А. Рабочего – ОрелГТУ, 1999.

К-во Просмотров: 492
Бесплатно скачать Курсовая работа: Разработка схемы блока арифметико-логического устройства для умножения двух двоичных чисел